Об окончания сложения свидетельствует импульсный сигнал R из блока вывода и нулевой последний перенос. В случае если эти условия выполняются, результат преобразуется в прямой код и подается на выход вместе с признаком переполнения и сигналом завершения операции сложения. До формирования сигнала завершения все сигналы на выходе равны нулю. Результат сложения поступает в блок преобразований кода, на выходе которого формируются код Грея и сигналы управления семисегментными индикаторами.
В схеме предусмотрен контроль по модулю два, который реализован на триггерах DD72, DD73 и двух элементах ИСКЛЮЧАЮЩЕЕ ИЛИ DD41:2, DD41:3.
Заключение
В результате выполненной работы был разработан 16-ти разрядный последовательный сумматор двоичных чисел с фиксированной запятой. Сумматор полностью отвечает требованиям, заданным в техническом задании. В работе были использованы элементы ТТЛ логики маломощных серий. Разработаны средства встроенного контроля работы сумматора методом контроля по модулю два. Обеспечено преобразование результата суммирования в код Грея и формирование управляющих сигналов семисегментных индикаторов для отображения суммы в десятичном представлении.
Список литературы
1. Аванесян Г.Р., Левшин В.П. Интегральные микросхемы ТТЛ, ТТЛШ: Справочник. – М.: Машиностроение, 1993. – 256 с.: ил.
2. Пухальский Г.И., Новосельцева Т.Я. Проектирование дискретных устройств на интегральных микросхемах: Справочник. – М.: Радио и связь, 1990. – 304 с.: ил.
3. Угрюмов Е.П. Цифровая Схемотехника: Учеб. пособие для вузов. – 2‑ое изд., перераб. и доп. – СПб.: БХВ-Петербург, 2004. – 800 с.: ил.
4. Файзулаев Б.Н., Тарабрин Б.В. Применение интегральных микросхем в электронной вычислительной технике: Справочник. – М.: Радио и связь, 1986.
5. Шило В.Л. Популярные цифровые микросхемы: Справочник. – М.: Радио и связь, 1988.